EPM7128SLC84-15
CPLD - MAX 7000 128 Macro 68 IOs
產(chǎn)品: MAX 7000
大電池數(shù)量: 128
邏輯數(shù)組塊數(shù)量——LAB: 8
最大工作頻率: 147.1 MHz
傳播延遲—最大值: 6 ns
輸入/輸出端數(shù)量: 68 I/O
工作電源電壓: 3.3 V
工作溫度: 0 C + 70 C
封裝 : PLCC-84
存儲類型: EEPROM
柵極數(shù)量: 2500
系列: EPM7128S MAX 7000S
工廠包裝數(shù)量: 15
電源電壓-最大: 3.6 V
電源電壓-最小: 3 V
商標(biāo)名: MAX 7000
單位重量: 6.778 g
Altera MAX? II/IIG/IIZ CPLD
Altera MAX? II CPLD系列是有史以來功耗最低、成本最低的CPLD。Altera的MAX II CPLD系列基于突破性的體系結(jié)構(gòu)，在所有CPLD系列中其單位I/O引腳的功耗和成本均最低。隨著MAX IIZ CPLD的推出，共有三種型號產(chǎn)品都使用了同樣的創(chuàng)新CPLD體系結(jié)構(gòu)：MAX II，MAX IIG和MAX IIZ。MAX IIZ CPLD具有零功耗的特性，與低成本MAX II CPLD系列有相同的非易失、即用性優(yōu)勢，可用于多種功能和應(yīng)用。MAX II CPLD系列是即用性、非易失器件，面向低密度通用邏輯和便攜式應(yīng)用，例如蜂窩手機(jī)設(shè)計(jì)等。
特性- 低成本、低功耗CPLD
- 即用性、非易失體系結(jié)構(gòu)
- 待機(jī)電流低至25 μA
- 支持快速傳輸延遲和時鐘至輸出延時
- 帶有四個全局時鐘，其中每個邏輯陣列模塊（LAB）可用兩個時鐘
- UFM模塊的非易失存儲高達(dá)8 Kbits
- MultiVolt內(nèi)核能向器件提供3.3V/2.5V或 1.8V的外部電壓
- MultiVolt I/O接口支持3.3-V、2.5-V、1.8-V和1.5-V邏輯電平
- 總線友好型體系結(jié)構(gòu)包括有可編程擺率、驅(qū)動強(qiáng)度、總線保持和可編程上拉電阻
- 施密特觸發(fā)器啟用噪聲容限輸入（每個引腳均可編程）
- 對于66MHz下的3.3-V操作，I/O完全符合外設(shè)部件互連標(biāo)準(zhǔn)特別興趣小組（PCI SIG）PCI本地總線規(guī)范修訂版2.2要求
- 支持熱插拔
- 內(nèi)置聯(lián)合測試行動組（JTAG）邊界掃描測試（BST）電路符合IEEE標(biāo)準(zhǔn)1149.1-1990
- ISP電路符合IEEE標(biāo)準(zhǔn)1532
| 應(yīng)用- 上電順序
- 系統(tǒng)配置
- I/O擴(kuò)展
- 接口橋接
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MAX II特性
MAX II方框圖
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